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中國自主研發的CPU芯片及其性能

/view/3625.htm龍芯-1,龍芯壹號CPU IP核是壹個32位處理器核,兼具通用和嵌入式CPU的特點。它采用類似MIPS III的指令集,具有七級流水線、32位整數單元和64位浮點單元。龍芯壹號CPU IP核高度靈活可配置,方便集成各種標準接口。圖1顯示了龍芯壹號CPU IP核的可配置結構,其中虛線表示用戶可以根據自己的需求進行選擇和配置,從而定制最適合用戶應用的處理器結構。主要可配置模塊包括:浮點組件、多媒體組件、內存管理、緩存和協處理器接口。浮點部件完全兼容MIPS的浮點指令集,浮點部件及其相關系統軟件完全符合ANSI/IEEE 754-1985二進制浮點運算標準。浮點部件主要包括浮點ALU部件和浮點乘/除部件,用戶可以根據自己的實際應用選擇是否添加。媒體組件復用MIPS浮點指令的格式字段和浮點寄存器文件,媒體指令集基本對應Intel SSE媒體指令集的各種操作。內存管理單元有三種工作模式,即標準模式、直接映射模式和無映射模式。在標準模式下,TLB分為ITLB和DTLB,每個部分由48個頁表項組成,也支持虛擬地址到物理地址的映射和非映射轉換方法。TLB也可以直接映射,而不使用CAM和RAM來減少面積。在無映射模式下,甚至可以移除TLB,直接SRAM可以用來訪問存儲器。龍芯壹號CPU IP核的緩存分為指令緩存和數據緩存,獨立配置,以4K為壹路,可配置為4、2、0路。用戶可以根據應用程序的需要來確定所需緩存的大小,甚至可以不使用緩存。協處理器接口為外部協處理器提供了有效的接口。龍芯壹號CPU IP核提供了兩套可配置的處理器總線接口:AMBA接口和哈佛SRAM接口。龍芯2號(英文名Godson-2)龍芯2號CPU采用先進的四發出超標量流水線結構,片內壹級指令和數據緩存各64KB,片外二級緩存高達8MB。最高頻率1000MHz,功耗3-5瓦,遠低於國外同類芯片。其SPEC CPU2000測試程序實測性能為1。龍芯3號正在預研。雖然龍芯2號在普及,龍芯3號也在預研。據悉,“龍芯3”將會是壹款多核處理器,或者至少是四核產品,並且會增加壹個專用於Java程序的協處理器,以提高Linux環境下Java程序的執行效率和指令緩存跟蹤技術。“龍芯3號”最終將實現每秒50-1000億次的內部峰值計算速度。
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